參數(shù)資料
型號(hào)： MC9S12P64CFTR
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, QCC48
封裝： 7 X 7 MM, 1 MM HEIGHT, 0.50 MM PITCH, MO220VKKD-2, QFN-48
文件頁(yè)數(shù)： 553/564頁(yè)
文件大?。?/td> 7066K
代理商： MC9S12P64CFTR
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Port Integration Module (S12PPIMV1)
S12P-Family Reference Manual, Rev. 1.12
Freescale Semiconductor
89
2.3.43
Port P Reduced Drive Register (RDRP)
5
DDRP
Port P data direction—
This bit determines whether the associated pin is an input or output.
The PWM forces the I/O state to be an output for an enabled channel. If the emergency shut-down feature is enabled
this pin is an input. In this case the data direction bit will not change.
1 Associated pin is congured as output
0 Associated pin is congured as input
4-0
DDRP
Port P data direction—
This bit determines whether the associated pin is an input or output.
The PWM forces the I/O state to be an output for an enabled channel. In this case the data direction bit will not
change.
1 Associated pin is congured as output
0 Associated pin is congured as input
Address 0x025B
Access: User read/write(1)
1. Read: Anytime
Write: Anytime
76543210
R
RDRP7
0
RDRP5
RDRP4
RDRP3
RDRP2
RDRP1
RDRP0
W
Reset
00000000
Figure 2-41. Port P Reduced Drive Register (RDRP)
Table 2-38. RDRP Register Field Descriptions
Field
Description
7,5-0
RDRP
Port P reduced drive—Select reduced drive for output pin
This bit congures the drive strength of the associated output pin as either full or reduced. If a pin is used as input
this bit has no effect. The reduced drive function is independent of which function is being used on a particular pin.
1 Reduced drive selected (approx. 1/5 of the full drive strength)
0 Full drive strength enabled
Table 2-37. DDRP Register Field Descriptions (continued)
Field
Description
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PDF描述
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